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基本信息
書名:數字電子技術 (第2版)(普通高等教育“十一五”規劃教材)
定價:36.00元
作者:成立
齣版社:機械工業齣版社
齣版日期:2009-05-01
ISBN:9787111131823
字數:
頁碼:
版次:1
裝幀:平裝
開本:16開
商品重量:0.499kg
編輯推薦
內容提要
本書是編者根據2004年8月教育部高等學校電子信息科學與電氣信息類基礎課程教學指導委員會頒布的“數字電予技術基礎”課程的教學基本要求,結閤多年來教學改革的經驗編寫而成的一仝書共分9章,內容有:數字電路基礎、集成邏輯門電路、組閤邏輯電路、集成觸發器、時乎邏輯電路、半導體存儲器和可編程邏輯器件、數模與模數轉換器、脈衝渡形的産生與變換和EDA軟件工具應用等。本書的卡要知識點都配備有適當的例題和習題,為學生課後復習、練習和歸納總結提供必需的資料。書末還備有學習本課程所需的附錄A-C和部分習題答案。
本書為普通高等教育“十一五”*規劃教材。全書思路順暢,層次分明,文字簡練,適閤於理工科高等院校電氣信息類專業(含自動化、電氣技術、電子信息工程、電子信息科學與技術、生物醫學工程、通信、計算機、測控和機電體化等)“數寜電子技術”或“數字集成電路”等課程教學,也可供從事微電子技術和電氣信息類工業的工程技術人員參考。
目錄
第2版前言
版前言
章 數字電路基礎
引言
1.1 數字電路概述
1.1.1 模擬信號和數寜信號
1.1.2 數字電路的特點
1.1.3 數字電路的發展與分類
1.1.4 數字電路的分析方法
1.2 計數製與編碼
1.2.1 常用的計數製及其相可轉換規律
1.2.2 編碼
1.3 邏輯代數基礎
1.3.1 邏輯代數的3種基本運算
1.3.2 邏輯代數的基本公式和常用公式
1.3.3 邏輯代數的基本規則
1.4 邏輯函數的建市及其錶示方法
1.5 邏輯函數的化簡
1.5.1 邏輯函數的簡形式
1.5.2 邏輯函數的公式化簡法
1.5.3 用卡諾圖化簡邏輯函數
1.6 具有無關項邏輯函數的化簡
1.7 數字電路中的半導體器件
1.7.1 本行半導體
1.7.2 雜質半導體
1.7.3 PN結及其單嚮導電性
1.7.4 半導體二極管
1.7.5 姐極型晶體三極管
1.7.6 增強型絕緣柵場效應晶體管
習題1
第2章 集成邏輯門電路
引言
2.1 基本邏輯門電路
2.1.1 二極管與門及或門電路
2.1.2 非門電路
2.2 TTL邏輯門電路。
2.2.1 TTL與非門的電路結構和工作原理
2.2.2 TTL與非門的技術參數
2.2.3 集電極開路門和三態門
2.3 射極耦閤邏輯門電路(ECL門)
2.4 CMOS邏輯門電路
2.4.1 CMOS反相器
2.4.2 CMOS門電路
2.4.3 CMOS傳輸門和雙嚮模擬開關
2.4.4 CMOS漏極開路門及三態門
2.5 BiCMOS門電路。
2.5.1 BiCMOS反豐同器
2.5.2 BiCMOS邏輯門電路
2.6 邏輯門電路使用中的幾個問題
2.6.1 正負邏輯問題
2.6.2 邏輯門電路多餘輸入端的處埋措施
2.6.3 邏輯門電路應用舉例
2.7 幾種集成門電路的性能比較
習題2
第3章 組閤邏輯電路
引言
3.1 組閤邏輯電路概述
3.2 組閤羅輯電路的分析
3.2.1 分析組閤邏輯電路的一般步驟
3.2.2 幾種常用的組閤邏輯電路和器件
3.3 組閤邏輯電路的設計
3.3.1 組颱邏輯電路的設計概述
3.3.2 組閤邏輯電路的設計方法
3.4 用小規模集成電路(SSI)實現組閤邏輯電路設計
3.4.1 設計組閤邏輯電路的一般步驟
3.4.2 組閤邏輯電路設計舉側
3.4.3 編碼器
3.4.4 譯碼器
3.4.5 數值比較器
3.5 組閤邏輯電路中的競爭冒險
3.5.1 産生競爭冒險的原幽
3.5.2 消除競爭冒險的方法
3.6 用MSI芯片設計其他的組閤邏輯電路
3.6.1 用數據選擇器實現組閤邏輯功能
3.6.2 用譯碼器實現多種組閤邏輯功能
3.6.3 用全加器實現多種組閤邏輯功能
3.7 組閤邏輯電路的綜閤應用例
習題3
第4章 集成觸發器
第5章 時序邏輯電路
第6章 半導體存儲器和可編程邏輯器件
第7章 數模與模數轉換器
第8章 脈衝波形的産生與變換
第9章 EDA軟件工具應用
附錄
部分習題答案
參考文獻
作者介紹
文摘
序言
這本號稱“數字電子技術”的教材,拿到手上翻瞭幾頁,實在讓人提不起精神來。講義的編排方式像是上世紀八十年代的産物,內容堆砌得毫無章法,章節之間的邏輯跳躍得讓人摸不著頭腦。比如,講到組閤邏輯電路時,突然插入瞭一大段關於特定集成電路的介紹,等你費勁消化完那些晦澀的型號和參數,再想迴頭理解前麵布爾代數的基礎,已經完全失去瞭語境。作者似乎急於把所有能想到的知識點都塞進去,卻忽略瞭知識傳遞的連貫性和讀者的接受能力。更糟糕的是,書中的插圖和例題質量也堪憂,很多圖示模糊不清,甚至存在明顯的錯誤,這對於初學者來說簡直是災難性的誤導。我花瞭很長時間試圖通過這些“範例”來鞏固理論知識,結果發現,很多題目給齣的答案和推導過程根本站不住腳,不得不自己重新推導,這極大地浪費瞭學習時間,讓人懷疑齣版方在審校環節到底做瞭多少工作。如果這是“十一五”規劃的教材,那當年的規劃標準實在令人擔憂。這本書讀起來更像是一本技術手冊的拼湊集,而不是一本引導學生理解核心概念的優秀教材。
評分這本書給我的整體感受是“陳舊”和“脫節”。雖然它標注瞭是“第二版”,但內容更新的速度完全跟不上技術發展的步伐。數字電子技術發展日新月異,新的器件、新的設計範式層齣不窮,但這本書似乎把時間定格在瞭上一個技術周期。例如,關於存儲器部分的介紹,過多地糾纏於早期的靜態隨機存取存儲器(SRAM)的細節和讀寫時序,對於現代係統中普遍應用的大容量動態隨機存取存儲器(DRAM)的刷新機製和關鍵參數介紹得過於簡略,缺乏深度。再比如,在提及可編程邏輯器件(PLD)時,僅僅是淺嘗輒止地提到瞭GAL和PAL的基本概念,對於更主流的現場可編程門陣列(FPGA)的結構、開發流程和應用潛力幾乎沒有涉及。這使得學生在學完這本書後,麵對當前實際的電子産品開發和係統設計時,會發現自己掌握的知識體係存在巨大的鴻溝,需要花費大量額外精力去彌補這些與行業前沿脫節的部分。
評分作為一本麵嚮工程技術人纔培養的教材,其最大的缺陷在於缺乏必要的工程思維訓練。它更像是一本純粹的“理論證明集”。書中大量的篇幅用於證明某個電路或某個邏輯功能的數學等價性,卻極少引導讀者思考“在實際資源受限的環境下,如何選擇最優的實現方案”。例如,在討論加法器設計時,它詳細介紹瞭串行和並行加法器的結構,但對於如何權衡延遲、功耗和麵積這三個在實際芯片設計中至關重要的指標,書中幾乎沒有深入的討論或對比分析。學習數字電路的目的,最終是為瞭能夠設計齣可靠、高效的數字係統,而這本書提供的知識框架,似乎將理論與實踐的橋梁完全架空瞭。我希望看到的,是結閤實際案例和設計約束的分析過程,而不是僅僅停留在抽象的邏輯層麵。這本書的閱讀體驗告訴我,它更適閤那些隻需要通過考試的理論學習者,而不是真正想投身於電子係統設計領域的實踐者。
評分翻閱此書的過程,真是一次對耐心的考驗。這本書的語言風格非常學術化,但這種“學術”的背後,常常是故作高深的晦澀錶達。很多定義和推導過程都繞瞭巨大的彎子,用最復雜的數學語言來描述一個本可以用簡單邏輯就能闡述清楚的概念。舉個例子,描述一個簡單的譯碼器功能時,書中用瞭三頁紙的篇幅來論證其唯一性和完備性,這對於需要快速掌握應用方法的讀者來說,無疑是冗餘且令人氣餒的。我常常需要對照著網絡上其他更現代、更清晰的資料纔能理解書中某段話的真實意圖。此外,這本書的裝幀和紙張質量也讓人不敢恭維,印刷的清晰度時好時壞,有些關鍵的錶格文字邊緣模糊,長時間閱讀眼睛非常容易疲勞。對於一本作為學習工具的教材,閱讀體驗的重要性不亞於內容本身。一個不舒適的閱讀體驗,會直接削弱學習的動力,讓原本就枯燥的理論學習變得更加煎熬。我對這種重理論而輕實踐、重堆砌而輕梳理的編著方式感到非常失望。
評分我手裏拿著的這本教材,與其說是一本麵嚮普通高等教育的“規劃教材”,不如說它更像是某位資深工程師的私人筆記匯編,充滿瞭未經梳理的知識點和過於深入的細節,完全不適閤入門者。例如,在講解時序邏輯電路時,它直接跳過瞭對基本觸發器(如RS、D、JK)工作原理的直觀圖解和波形分析,而是直接拋齣瞭一大堆復雜的反饋方程和狀態轉移圖,美其名曰“嚴謹”。這種“嚴謹”的代價是犧牲瞭讀者的理解深度。對於剛接觸數字電路的同學來說,看到這些公式就像看天書一樣,根本無法建立起對電路動態行為的直觀認識。我嘗試去尋找一些現代化的設計思路,比如結構化描述語言的應用,但書中內容似乎還停留在純粹的門級電路分析上,對諸如VHDL或Verilog這些行業標準工具的提及微乎其微,這與當今工程實踐的要求嚴重脫節。我原本期待能學到如何將理論轉化為實際設計的能力,結果發現,這本書教給我的更多是死記硬背的知識點,而非解決問題的思維框架。如果目標是培養能適應未來挑戰的工程師,那麼這種保守到近乎僵化的內容結構是遠遠不夠的。
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