: 0 = 保持锁定
评分当通过ispLEVER 模块生成器生成PCS模块时,如果选择了“Error Status Ports” ,根据PCS/FPGA接口的
评分信号。
评分cc_overrun_ch(0-3) ,可以对每个通道上的时钟补偿FIFO过载进行监测。
评分2. RX_SERDES_RESET: 使rx_serdes_rst_ch[3:0]_c 和rx_pcs_rst_ch[3:0]_c 有效。
评分上电和配置后,进行所有SERDES复位和FPGA 复位。
评分TX复位序列
评分间间隙等于4 (CC_MATCH_MODE = “4”)乘以 3 (表 8-10中CC_MIN_IPG = “2”)或 12字节。PCS不会执行跳
评分它有效时,rx_los_low[3:0]_s 变为高电平。
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